基于Leon3處理器SoC低功耗設(shè)計(jì)研究.pdf_第1頁
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文檔簡介

1、功耗問題已經(jīng)成為集成電路設(shè)計(jì)中繼速度、面積和可測性之后又一個重要的研究熱點(diǎn).本文進(jìn)行了具有零翻轉(zhuǎn)功能地址總線和門控時鐘的設(shè)計(jì),完成對以Leon3為核心的SoC功耗的優(yōu)化設(shè)計(jì). 嵌入式系統(tǒng)中,總線的功耗占總功耗的60﹪左右,對總線進(jìn)行功耗優(yōu)化是SoC低功耗設(shè)計(jì)的首選目標(biāo).本文采用VHDL語言完成地址總線的TO(總線零翻轉(zhuǎn))編碼設(shè)計(jì),有效地減少地址總線的翻轉(zhuǎn)次數(shù),從而降低整個SoC系統(tǒng)的功耗.分析結(jié)果顯示,在對5000條連續(xù)地址進(jìn)行

2、訪問時,總線采用TO編碼技術(shù)比未采用TO編碼技術(shù)總的動態(tài)功耗降低了11.29﹪. 另外,功耗還可以使用RTL門控時鐘進(jìn)行進(jìn)一步的優(yōu)化.本文介紹了門控時鐘技術(shù)的特點(diǎn),討論門控時鐘對綜合和時序分析的影響.利用Synopsys公司的DesignCompiler工具在綜合時完成了門控時鐘的設(shè)計(jì),分析結(jié)果顯示,在我們的設(shè)計(jì)中,使用RTL門控時鐘可以使系統(tǒng)動態(tài)功耗降低15.5﹪,面積也略有改善. 利用Design Compiler和

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