面向訪存公平性的多核NoC Cache分布優(yōu)化.pdf_第1頁(yè)
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文檔簡(jiǎn)介

1、近幾年片上多核芯片(Chip Multi-Processors,CMPs)逐漸成為了學(xué)術(shù)界和工業(yè)界的研究熱點(diǎn)。隨著多核芯片核數(shù)的擴(kuò)大,傳統(tǒng)的總線互連方式的帶寬、頻率和功耗問題顯得越來越突出。片上大量計(jì)算和存儲(chǔ)資源的并發(fā)工作需要并發(fā)流水的通信工作模式而非串行化的通信工作模式。因而,片上網(wǎng)絡(luò)(Network-on-Chip,NoC)由于良好的可擴(kuò)展性逐漸成為在單個(gè)芯片上連接眾多資源的較佳解決方案。
  同時(shí),隨著芯片規(guī)模的擴(kuò)大,集中式

2、的存儲(chǔ)組織方式由于訪問延遲過大、訪存競(jìng)爭(zhēng)嚴(yán)重和可擴(kuò)展性差而成為片上系統(tǒng)的性能和功耗瓶頸。而與此對(duì)應(yīng)的是,分布式的存儲(chǔ)組織方式具有可擴(kuò)展性好及訪問競(jìng)爭(zhēng)和延遲均衡的優(yōu)點(diǎn)。
  綜上所述,片上系統(tǒng)逐漸由基于總線的單核或少量多核結(jié)構(gòu)發(fā)展到基于片上網(wǎng)絡(luò)和分布式共享并行存儲(chǔ)的大量多核(眾核)結(jié)構(gòu)。在這種情況下非一致性訪存結(jié)構(gòu)(Non-Uniform Cache Access,NUCA)成為當(dāng)前多核芯片設(shè)計(jì)的主流存儲(chǔ)結(jié)構(gòu)顯得理所當(dāng)然。然而隨著多

3、核芯片規(guī)模的快速增大,多核芯片中不同節(jié)點(diǎn)的訪存公平性問題日趨嚴(yán)重。為了解決這個(gè)棘手的問題,本文從非一致性訪存結(jié)構(gòu)的訪存公平性入手進(jìn)行了以下幾方面的工作:
  1)針對(duì)當(dāng)前片上多核芯片中非一致性訪存結(jié)構(gòu)特點(diǎn)對(duì)芯片上不同節(jié)點(diǎn)訪存的延遲進(jìn)行建模。具體來說,本文提出了一個(gè)訪存延遲估算模型,可對(duì)芯片上各個(gè)節(jié)點(diǎn)的平均訪存延遲進(jìn)行較為準(zhǔn)確的估計(jì);
  2)以分布式共享cache劃分的研究問題為目標(biāo),以本文所建立的訪存延遲模型為依據(jù),用一種

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