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1、聯(lián)系聯(lián)系QQ1165557537第2525章可編程邏輯器件可編程邏輯器件PLDPLD器件器件25.1PLD的符號(hào)表示可編程邏輯器件(可編程邏輯器件(ProgrammableProgrammableLogicLogicDeviceDevice,簡(jiǎn)稱,簡(jiǎn)稱PLDPLD):):能夠簡(jiǎn)化設(shè)計(jì)過(guò)程、降低系統(tǒng)體積、節(jié)約成本、提高可靠性、縮短研發(fā)周期、各個(gè)廠家可以提供、具有一定連線和封裝好的具有一定功能的標(biāo)準(zhǔn)電路。用戶可以根據(jù)需要自己使用某種編程技術(shù)
2、進(jìn)行內(nèi)部電路結(jié)構(gòu)的連接,實(shí)現(xiàn)用戶既是設(shè)計(jì)者也是使用者的轉(zhuǎn)變。PLD電路分為四部分:輸入緩沖電路、與陣列、或陣列、輸出緩沖電路由于PLD內(nèi)部陣列的連接規(guī)模十分龐大,用傳統(tǒng)的邏輯電路圖很難描述,所以采用了中所示的簡(jiǎn)化畫(huà)法,這也是目前國(guó)際、國(guó)內(nèi)通用的畫(huà)法。(a)與門(mén)(b)或門(mén)(c)輸出恒等于0的與門(mén)輸入緩沖電路與陣列或陣列輸出緩沖電路輸入輸出……CDAABCDABABBDAABCDENENCPLD。CPLDCPLD構(gòu)成原理:構(gòu)成原理:由可編程
3、邏輯的功能塊圍繞位于中心的可編程互連矩陣構(gòu)成,使用金屬線實(shí)現(xiàn)邏輯單元之間的連接,可編程邏輯單元類似于PAL的與陣列,采用可編程的與陣列和固定的或陣列結(jié)構(gòu)。再加上共享的可編程與陣列,將多個(gè)宏單元連接起來(lái),增加了IO控制模塊的數(shù)量與功能。CPLD的基本結(jié)構(gòu):的基本結(jié)構(gòu):(1)可編程邏輯宏單元(2)可編程IO控制模塊(3)可編程內(nèi)部連線三部分組成(1)可編程邏輯宏單元)可編程邏輯宏單元可編程邏輯宏單元(LogicMacroCell,簡(jiǎn)稱LMC
4、)主要包括與陣列、或陣列、多路數(shù)據(jù)選擇器和可編程觸發(fā)器,可獨(dú)立選擇組合或時(shí)序工作方式。CPLD器件與GAL器件類似,其邏輯宏單元也是采用OLMC、即輸出邏輯宏單元,但它的宏單元數(shù)量與與陣列數(shù)量比GAL大的多。邏輯宏單元具有密度高、乘積項(xiàng)共享結(jié)構(gòu)、多觸發(fā)器、異步時(shí)鐘等特點(diǎn)。(2)可編程)可編程IO單元單元CPLD的IO單元(InputOutputCell,簡(jiǎn)稱IOC),是內(nèi)部信號(hào)與IO引腳之間的接口部分,不同功能的器件,結(jié)構(gòu)也不盡相同。一
5、般IO作為一個(gè)獨(dú)立的單元處理,由三態(tài)輸出緩沖器、輸出極性選擇、輸出選擇等部分組成。(3)可編程內(nèi)部連線)可編程內(nèi)部連線可編程內(nèi)部連線的作用是在各邏輯宏單元之間及邏輯宏單元與IO單元之間提供互連網(wǎng)絡(luò)。通過(guò)它,邏輯宏單元接收輸入端的信號(hào)、并傳遞宏單元的信號(hào)。25.2.5現(xiàn)場(chǎng)可編程門(mén)陣列現(xiàn)場(chǎng)可編程門(mén)陣列現(xiàn)場(chǎng)可編程門(mén)陣列(現(xiàn)場(chǎng)可編程門(mén)陣列(FPGA)FPGA簡(jiǎn)介:簡(jiǎn)介:FPGA出現(xiàn)在上世紀(jì)80年代中期,它是由許多獨(dú)立的可編程邏輯模塊組成,用戶可
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