基于高層次綜合的MCU IP核的設(shè)計(jì)研究.pdf_第1頁(yè)
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文檔簡(jiǎn)介

1、該文在對(duì)Intel MCS-8051 MCU指令集進(jìn)行深入分析的基礎(chǔ)上,按照自頂向下的數(shù)字ASIC系統(tǒng)高層次設(shè)計(jì)流程,對(duì)MCU IP核進(jìn)行頂層功能和結(jié)構(gòu)的定義與劃分,并逐步細(xì)化了各個(gè)層次的模塊設(shè)計(jì),建立了具有特色的MCU IP軟核模型.該文完成了MCU IP核數(shù)據(jù)通路和控制通路各個(gè)層次模塊的設(shè)計(jì)規(guī)劃,使用硬件描述語(yǔ)言VHDL,實(shí)現(xiàn)了MCU IP核各模塊的設(shè)計(jì);借助EDA工具ISE集成開(kāi)發(fā)環(huán)境完成了IP核各模塊的編程、調(diào)試和面向FPGA的

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