16位DSP IP核的設計與驗證技術.pdf_第1頁
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文檔簡介

1、近年來，隨著信號處理技術的發(fā)展，DSP作為關鍵的信號處理芯片處于飛速發(fā)展的階段。本文設計了一個16位定點DSP，該DSP的存儲器采用哈佛結構，指令的執(zhí)行采用四級流水線結構，通過DAG模塊完成數(shù)據(jù)的存取操作，通過PAG模塊完成程序存取操作，通過流水線控制器完成指令的譯碼操作，CALU和PLU以及存儲映射寄存器完成指令的執(zhí)行以及對數(shù)據(jù)的運算操作等，時鐘的產生以及芯片的省電模式控制和外部中斷同步都是通過時鐘控制模塊完成；芯片外設包括串口、TD

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