針對(duì)SEPO718DDR多端口存儲(chǔ)控制器的調(diào)度算法的優(yōu)化設(shè)計(jì).pdf_第1頁(yè)
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1、隨著片上系統(tǒng)(SystemonChip,SoC)的集成度越來(lái)越大,越來(lái)越多的外設(shè)被集成到同一片SoC上,這些外設(shè)往往通過DDR多端口存儲(chǔ)控制器(DDRMulti-PortMemoryController,MPMC)共享外部存儲(chǔ)器。MPMC的研究也得到了越來(lái)越多的關(guān)注,特別的,在多媒體SoC中,各種主機(jī)設(shè)備對(duì)存儲(chǔ)器有不同的帶寬和延遲需求,調(diào)度算法作為MPMC的重要組成部分,其性能的好壞對(duì)整個(gè)SoC系統(tǒng)有較大的影響。因此,對(duì)MPMC調(diào)度算法

2、的研究具有重要的應(yīng)用價(jià)值。
   論文以SEP0718的MPMC為基礎(chǔ),從該芯片在實(shí)際應(yīng)用中的不足入手,就內(nèi)存復(fù)制和MPMC調(diào)度算法這兩方面對(duì)SEP0718的MPMC做了優(yōu)化。針對(duì)內(nèi)存復(fù)制,論文通過定制處理器對(duì)應(yīng)的MPMC端口的寫隊(duì)列深度以及增加預(yù)緩沖邏輯,有效的提高了內(nèi)存的復(fù)制效率;針對(duì)MPMC的調(diào)度算法,論文使用了改進(jìn)的差額算法。通過差額計(jì)數(shù)器追蹤各個(gè)主機(jī)端口的狀態(tài),該算法可以為各個(gè)主機(jī)端口分配帶寬;同時(shí),通過設(shè)置一個(gè)低延遲

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